XC3S1400A-5FGG484C IC programable
El paquete del microprocesador 484-BBGA integró la alta resolución de FPGAs defasadora
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Número de laboratorios/CLBs
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Número de elementos de lógica/de células
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RAM Bits total
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Número de entrada-salida
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Número de puertas
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Voltaje - fuente
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Montaje del tipo
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Temperatura de funcionamiento
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Paquete/caso
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Paquete del dispositivo del proveedor
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Número bajo del producto
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XC3S1400A-5FGG484C
Características
• Recursos abundantes, flexibles de la lógica
• Densidades hasta 25.344 células de la lógica, incluyendo cambio opcional
registro o ayuda distribuida de RAM
• Multiplexores anchos eficientes, lógica amplia
• Rápido anticipe llevan lógica
• 18 x 18 multiplicadores aumentados con la tubería opcional
• Programación/eliminar errores de IEEE 1149.1/1532 JTAG del puerto
• Arquitectura jerárquica de la memoria de SelectRAM™
• Hasta 576 Kbits del bloque rápido RAM con byte escriben permite para los usos del procesador
• Hasta 176 Kbits de RAM distribuido eficiente
• Hasta ocho encargados de reloj de Digitaces (DCMs)
• Eliminación oblicua del reloj (lazo bloqueado del retraso)
• Síntesis de la frecuencia, multiplicación, división
• Defasador de alta resolución
• Gama de frecuencia ancha (5 megaciclos a más de 320 megaciclos)
• Ocho redes globales del reloj de la bajo-posición oblicua, ocho relojes adicionales por el medio dispositivo, más la encaminamiento abundante de la bajo-posición oblicua
• Interfaz de la configuración a los bailes de fin de curso del estándar industrial
• Barato, BAILE DE FIN DE CURSO de destello serial de SPI del ahorro de espacio
• paralelo de x8 o de x8/x16 BPI NI BAILE DE FIN DE CURSO de destello
• Flash barato de la plataforma de Xilinx® con JTAG
• Identificador único de la DNA del dispositivo para la autentificación del diseño
• Bitstreams múltiples de la carga bajo control de FPGA
• comprobación del CRC de la Poste-configuración
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