Entrada-salida Xilinx Virtex 5 de XC5VLX50-2FF1153I 560
Number modelo:XC5VLX50-2FF1153I
Cantidad de orden mínima:1 PCS
Condiciones de pago:T/T, Western Union, Paypal, garantía comercial, tarjeta de crédito
Capacidad de la fuente:332 PC
Plazo de expedición:3-5 día
Detalles de empaquetado:Empaquetado del estándar internacional
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Miembro activo
Shenzhen Guangdong China
Dirección:
R1811, edificio de B, torre de Jiahe, No.3006 Shennan mediados de Rd, Shenzhen, China
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Dentro de 27 Horas
Detalles del producto
Perfil de la compañía
Detalles del producto
Entrada-salida Virtex-5 de XC5VLX50-2FF1153I IC FPGA FBGA-1153 560
| Cualidad de producto | Valor del atributo |
|---|---|
| Xilinx | |
| FPGA - Arsenal de puerta programable del campo | |
| Virtex-5 | |
| Entrada-salida 560 | |
| 1 V | |
| - 40 C | |
| + 100 C | |
| SMD/SMT | |
| FBGA-1153 | |
| Serie: | XC5VLX50 |
| Marca: | Xilinx |
| RAM distribuido: | kbit 480 |
| Bloque integrado RAM - EBR: | kbit 1728 |
| Frecuencia de funcionamiento máxima: | 550 megaciclos |
| Humedad sensible: | Sí |
| Tipo de producto: | FPGA - Arsenal de puerta programable del campo |
| Cantidad del paquete de la fábrica: | 1 |
| Subcategoría: | Lógica programable ICs |
| Marca registrada: | Virtex |
Resumen de las características de Virtex-5 FPGA
• Capacidad de la supervisión de sistema en todos los dispositivos
En-microprocesador del −/supervisión termal fuera de chip
En-microprocesador del −/supervisión fuera de chip de la fuente de alimentación
Acceso del − JTAG a todas las cantidades supervisadas
• Bloques integrados de la punto final para los diseños de PCI Express
Plataformas del − LXT, de SXT, de TXT, y de FXT
− obediente con la especificación baja 1,1 de PCI Express
ayuda del carril x1, x4, o x8 del − por bloque
Trabajos del − conjuntamente con los transmisores-receptores de RocketIO™
• Ethernet MAC del Tri modo 10/100/1000 Mb/s
Plataformas del − LXT, de SXT, de TXT, y de FXT
Los transmisores-receptores de RocketIO del − se pueden utilizar como PHY o conectan con PHY externo usando muchas opciones suaves MII (del medios interfaz independiente)
• Transmisores-receptores de RocketIO GTP 100 Mb/s a 3,75 Gb/s
− LXT y plataformas de SXT
• Transmisores-receptores de RocketIO GTX
• Rebanadas avanzadas de DSP48E
− 25 x 18, el complemento de los two, multiplicación
Serpiente, restador, y acumulador opcionales del −
Cañería opcional del −
Función lógica opcional del − bitwise
Conexiones de cascada dedicadas del −
• Opciones de configuración flexible
− SPI e interfaz DE DESTELLO paralelo
ayuda del Multi-bitstream del − con lógica dedicada de la reconfiguración del retraso
Capacidad auto de la detección de la anchura del autobús del −
En-microprocesador del −/supervisión termal fuera de chip
En-microprocesador del −/supervisión fuera de chip de la fuente de alimentación
Acceso del − JTAG a todas las cantidades supervisadas
• Bloques integrados de la punto final para los diseños de PCI Express
Plataformas del − LXT, de SXT, de TXT, y de FXT
− obediente con la especificación baja 1,1 de PCI Express
ayuda del carril x1, x4, o x8 del − por bloque
Trabajos del − conjuntamente con los transmisores-receptores de RocketIO™
• Ethernet MAC del Tri modo 10/100/1000 Mb/s
Plataformas del − LXT, de SXT, de TXT, y de FXT
Los transmisores-receptores de RocketIO del − se pueden utilizar como PHY o conectan con PHY externo usando muchas opciones suaves MII (del medios interfaz independiente)
• Transmisores-receptores de RocketIO GTP 100 Mb/s a 3,75 Gb/s
− LXT y plataformas de SXT
• Transmisores-receptores de RocketIO GTX
• Rebanadas avanzadas de DSP48E
− 25 x 18, el complemento de los two, multiplicación
Serpiente, restador, y acumulador opcionales del −
Cañería opcional del −
Función lógica opcional del − bitwise
Conexiones de cascada dedicadas del −
• Opciones de configuración flexible
− SPI e interfaz DE DESTELLO paralelo
ayuda del Multi-bitstream del − con lógica dedicada de la reconfiguración del retraso
Capacidad auto de la detección de la anchura del autobús del −
Entrada-salida Xilinx Virtex 5 de XC5VLX50-2FF1153I 560
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