800 ENTRADA-SALIDA 550MHz XC5VLX155-2FFG1153C IC FPGA
Number modelo:XC5VLX155-2FFG1153C
Cantidad de orden mínima:1 PCS
Condiciones de pago:T/T, Western Union, Paypal, garantía comercial, tarjeta de crédito
Capacidad de la fuente:126 PC
Plazo de expedición:3-5 día
Detalles de empaquetado:Empaquetado del estándar internacional
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Miembro activo
Shenzhen Guangdong China
Dirección:
R1811, edificio de B, torre de Jiahe, No.3006 Shennan mediados de Rd, Shenzhen, China
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Dentro de 27 Horas
Detalles del producto
Perfil de la compañía
Detalles del producto
Entrada-salida 550 megaciclo Virtex-5 de XC5VLX155-2FFG1153C IC FPGA FBGA-1153 800
| Cualidad de producto | Valor del atributo |
|---|---|
| Xilinx | |
| FPGA - Arsenal de puerta programable del campo | |
| Virtex-5 | |
| Entrada-salida 800 | |
| 1 V | |
| 0 C | |
| + 85 C | |
| SMD/SMT | |
| FBGA-1153 | |
| Serie: | XC5VLX155 |
| Marca: | Xilinx |
| RAM distribuido: | kbit 1640 |
| Bloque integrado RAM - EBR: | kbit 6912 |
| Frecuencia de funcionamiento máxima: | 550 megaciclos |
| Humedad sensible: | Sí |
| Tipo de producto: | FPGA - Arsenal de puerta programable del campo |
| Cantidad del paquete de la fábrica: | 1 |
| Subcategoría: | Lógica programable ICs |
| Marca registrada: | Virtex |
Resumen de las características de Virtex-5 FPGA
• Cinco plataformas LX, LXT, SXT, TXT, y FXT
− Virtex-5 LX: Usos generales de alto rendimiento de la lógica
− Virtex-5 LXT: Lógica de alto rendimiento con conectividad serial avanzada
− Virtex-5 SXT: Usos de alto rendimiento del tratamiento de señales con conectividad serial avanzada
− Virtex-5 TXT: Sistemas de alto rendimiento con conectividad serial avanzada de doble densidad
− Virtex-5 FXT: Sistemas integrados de alto rendimiento con conectividad serial avanzada
• Compatibilidad de la interplataforma
El − LXT, los dispositivos de SXT, y de FXT son huella compatible en el mismo paquete usando reguladores de voltaje ajustables
• Sincronización potente de la teja de la gestión del reloj (CMT)
Bloques del encargado de reloj de Digitaces del − (DCM) para proteger del retraso, la síntesis de la frecuencia, y el reloj cero defasador
Los bloques del − PLL para la entrada están inquietos filtrando, protegiendo cero del retraso, síntesis de la frecuencia, y división fase-hecho juego del reloj
• Capacidad de la supervisión de sistema en todos los dispositivos
En-microprocesador del −/supervisión termal fuera de chip
En-microprocesador del −/supervisión fuera de chip de la fuente de alimentación
Acceso del − JTAG a todas las cantidades supervisadas
Virtex®-5 FPGAs están disponibles en -3, -2, -1 grados de la velocidad, con -3 teniendo el rendimiento más alto. Virtex-5 FPGA DC
y las características de la CA se especifican para los grados comerciales e industriales. Excepto la temperatura de funcionamiento
la gama o a menos que se indicare en forma diferente, todos los parámetros eléctricos de DC y de la CA son lo mismo para una velocidad particular
grado (es decir, las características de la sincronización de un dispositivo industrial del grado de la velocidad -1 son lo mismo que para un grado de la velocidad -1
dispositivo comercial). Sin embargo, solamente los grados de la velocidad y/o los dispositivos seleccionados pudieron estar disponibles en la gama industrial.
Todas las especificaciones del voltaje de fuente y de la temperatura de empalme son representante de condiciones a lo peor.
los parámetros incluidos son comunes a los diseños populares y a los usos típicos.
− Virtex-5 LX: Usos generales de alto rendimiento de la lógica
− Virtex-5 LXT: Lógica de alto rendimiento con conectividad serial avanzada
− Virtex-5 SXT: Usos de alto rendimiento del tratamiento de señales con conectividad serial avanzada
− Virtex-5 TXT: Sistemas de alto rendimiento con conectividad serial avanzada de doble densidad
− Virtex-5 FXT: Sistemas integrados de alto rendimiento con conectividad serial avanzada
• Compatibilidad de la interplataforma
El − LXT, los dispositivos de SXT, y de FXT son huella compatible en el mismo paquete usando reguladores de voltaje ajustables
• Sincronización potente de la teja de la gestión del reloj (CMT)
Bloques del encargado de reloj de Digitaces del − (DCM) para proteger del retraso, la síntesis de la frecuencia, y el reloj cero defasador
Los bloques del − PLL para la entrada están inquietos filtrando, protegiendo cero del retraso, síntesis de la frecuencia, y división fase-hecho juego del reloj
• Capacidad de la supervisión de sistema en todos los dispositivos
En-microprocesador del −/supervisión termal fuera de chip
En-microprocesador del −/supervisión fuera de chip de la fuente de alimentación
Acceso del − JTAG a todas las cantidades supervisadas
Virtex®-5 FPGAs están disponibles en -3, -2, -1 grados de la velocidad, con -3 teniendo el rendimiento más alto. Virtex-5 FPGA DC
y las características de la CA se especifican para los grados comerciales e industriales. Excepto la temperatura de funcionamiento
la gama o a menos que se indicare en forma diferente, todos los parámetros eléctricos de DC y de la CA son lo mismo para una velocidad particular
grado (es decir, las características de la sincronización de un dispositivo industrial del grado de la velocidad -1 son lo mismo que para un grado de la velocidad -1
dispositivo comercial). Sin embargo, solamente los grados de la velocidad y/o los dispositivos seleccionados pudieron estar disponibles en la gama industrial.
Todas las especificaciones del voltaje de fuente y de la temperatura de empalme son representante de condiciones a lo peor.
los parámetros incluidos son comunes a los diseños populares y a los usos típicos.
800 ENTRADA-SALIDA 550MHz XC5VLX155-2FFG1153C IC FPGA
Carro de la investigación
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