ARM Cortex programable A9 de la base del SoC FPGA del microprocesador de FPGA del arsenal de puerta del campo de XC7Z010-1CLG400I

Number modelo:XC7Z010-1CLG400I
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Capacidad de la fuente:5000pcs por boca
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Shenzhen Guangdong China
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Detalles del producto

Zynq-7000 SoC

ARM Cortex programable A9 de la base del SoC FPGA del arsenal de puerta del campo de XC7Z010-1CLG400I FPGA

Especificaciones

Cualidad de productoValor del atributo
Xilinx
Categoría de producto:SoC FPGA
SMD/SMT
CSBGA-400
ARM Cortex A9
Base 2
667 megaciclos
kB 2 x 32
kB 2 x 32
28000 LE
Entrada-salida 100
- 40 C
+ 100 C
Marca:Xilinx
Número de bloques del arsenal de lógica - laboratorios:LABORATORIO 2200
Tipo de producto:Procesadores - el uso se especializó

Descripción

Basan a la familia Zynq®-7000 en la arquitectura de Xilinx SoC. Estos productos integran un dual-core característica-rico

o sistema de proceso basado Cortex™-A9 del solo-corazón ARM® (picosegundo) y lógica programable de 28 nanómetro Xilinx (PL) en a

solo dispositivo. Las CPU del BRAZO Cortex-A9 son el corazón del picosegundo y también incluyen la memoria del en-microprocesador, memoria externa

interfaces, y un sistema rico de interfaces periféricos de la conectividad.

Características

El BRAZO Cortex-A9 basó la unidad del procesador de uso (el APU)

• 2,5 DMIPS/MHz por la CPU

• Frecuencia de la CPU: Hasta 1 gigahertz

• Ayuda coherente del multiprocesador

• Arquitectura de ARMv7-A

• Seguridad de TrustZone®

• Sistema de instrucción Thumb®-2

• Arquitectura del ambiente de la ejecución del RCT de Jazelle®

• Motor de medio-proceso de NEON™

• Unidad sola y de precisión doble de la coma flotante del vector (VFPU)

• CoreSight™ y programa Trace Macrocell (PTM)

• Contador de tiempo e interrupciones

• Tres relojes de vigilancia

• Un contador de tiempo global

• Dos escondrijos de los contadores del triple-contador de tiempo

• Nivel 1 de 32 KB escondrijos sistema-asociativos de la instrucción y de los datos de 4 maneras (independientes para cada CPU)

• 512 escondrijo de nivel sistema-asociativo 2 de la manera del KB 8 (compartido entre las CPU)

• memoria del En-microprocesador de la ayuda de la Byte-paridad

• ROM de la bota del En-microprocesador

• En-microprocesador RAM (OCM) de 256 KB

• interfaces externos de la memoria de la ayuda de la Byte-paridad

• Regulador dinámico Multiprotocol de la memoria

• interfaces de 16 bits o de 32 bits a las memorias DDR3, DDR3L, DDR2, o LPDDR2

• Ayuda del ECC en modo de 16 bits

• 1GB del espacio de dirección usando la sola fila de 8, 16-, o 32 memorias pedazo-anchas

• Interfaces de memoria estática

• ómnibus de datos de 8 bits de SRAM con la ayuda de hasta 64 MB

• Paralelo NI ayuda de destello

• Ayuda de destello de ONFI1.0 NAND (ECC 1-bit)

• pedazo SPI, 2 pedazo SPI, 4 SPI de 1 pedazo (patio-SPI), o serial (de 8 bits) de dos patio-SPI NI controlador dma de destello del 8-canal

• Memoria-a-memoria, memoria-a-periférico, periférico-a-memoria, y ayuda de la transacción del dispersión-frunce

Guía comercial

                                                                               
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