El chip CI LVDS de DSLVDS1048PWR interconecta la línea diferenciada de alta velocidad receptor 3.3V de IC

Chip CI del circuito integrado de DSLVDS1048PWR

Línea diferenciada de alta velocidad paquete TSSOP-16 de IC del interfaz de LVDS del receptor 3.3V

DSLVDS1048PWR

Descripción de DSLVDS1048PWR

El dispositivo de DSLVDS1048PWR es un patio Cmos atraviesa la línea diferenciada receptor diseñado para los usos que requieren la disipación de poder ultrabaja y altas tarifas de datos. El dispositivo se diseña para apoyar tarifas de datos superior a 400 Mbps (200 megaciclos) usando tecnología diferenciada de la señalización de la baja tensión (LVDS).

El DSLVDS1048PWR acepta bajas señales de entrada diferenciadas de la tensión (350 milivoltio típicos) y las traduce a los niveles de producción de 3-V Cmos. El receptor apoya una función DE TRIPLE ESTADO que se pueda utilizar para multiplexar salidas. El receptor también apoya abierto, puesto en cortocircuito, y terminó la entrada (100-Ω) a prueba de averías. La salida del receptor es ALTA para todas las condiciones a prueba de averías. El DSLVDS1048 tiene atraviesa el pinout para la disposición fácil del PWB.

Las entradas del EN y de EN* son ANDed juntas y controlan las salidas DE TRIPLE ESTADO. Permite son común a los cuatro receptores. La línea conductor de DSLVDS1048 y del compañero LVDS (por ejemplo, DSLVDS1047) proporcionar una nueva alternativa a los dispositivos de alta potencia de PECL/ECL para los usos de punto a punto de alta velocidad del interfaz.

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