SN65LVDS100DR Buffer/Controlador LVDS 400Mbps Velocidad de Datos 3.3V Alimentación 100Ω Terminación Interna SOIC-8 -40°C a +85°C

SN65LVDS100DR Buffer/Driver LVDS 400Mbps Velocidad de datos 3.3V Suministro 100Ω Terminación interna SOIC-8 -40°C a +85°C

Características

• Diseñado para velocidades de señalización ≥ 2 Gbps 1

• Jitter total < 65 ps

• Alternativa de baja potencia para el MC100EP16

• Sesgo de parte a parte bajo de 100 ps (máximo)

• Histéresis de umbral de entrada del receptor de 25 mV sobre un rango de voltaje de entrada de 0 V a 4 V

• Entradas eléctricamente compatibles con los niveles de señal LVPECL, CML y LVDS

• Operación de suministro de 3.3 V

• LVDTIntegra una resistencia de terminación de 110-Ω

• Ofrecido en SOIC y MSOP

Aplicaciones

• Infraestructura inalámbrica

• Infraestructura de telecomunicaciones

• Impresoras

Descripción

Los SN65LVDS100, SN65LVDT100, SN65LVDS101 y SN65LVDT101 son receptores y controladores diferenciales de alta velocidad conectados como repetidores. El receptor acepta señales de entrada de señalización diferencial de bajo voltaje (LVDS), lógica acoplada por emisor positivo (PECL) o lógica de modo de corriente (CML) a velocidades de hasta 2 Gbps y la repite como una señal de salida LVDS o PECL. La ruta de la señal a través del dispositivo es diferencial para bajas emisiones radiadas y un jitter añadido mínimo.

Las salidas del SN65LVDS100 y SN65LVDT100 son niveles LVDS según lo definido por TIA/EIA-644-A. Las salidas del SN65LVDS101 y SN65LVDT101 son compatibles con los niveles PECL de 3.3 V. Ambos impulsan líneas de transmisión diferenciales con una impedancia característica nominal de 100-Ω.

El SN65LVDT100 y el SN65LVDT101 incluyen una resistencia de terminación de línea diferencial de 110-Ω para menos espacio en la placa, menos componentes y la longitud de stub más corta posible. No incluyen la referencia de voltaje VBB que se encuentra en el SN65LVDS100 y el SN65LVDS101. VBB proporciona una referencia de voltaje de típicamente 1.35 V por debajo de VCC para su uso en la recepción de señales de entrada de un solo extremo y es particularmente útil con entradas PECL de un solo extremo de 3.3 V. Cuando VBB no se usa, debe estar desconectado o abierto.

Todos los dispositivos están caracterizados para operar de –40°C a 85°C.

INFORMACIÓN

Dibujo

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