el circuito integrado de los 256M 143MHZ 54TSOP parte la memoria IC IS42S16160G-7TLI

Número de modelo:IS42S16160G-7TLI
Lugar del origen:ESTADOS UNIDOS
Cantidad de orden mínima:negociación
Condiciones de pago:T/T, Western Union, Paypal
Capacidad de la fuente:5000PCS/mes
Plazo de expedición:2-4 días laborables después de recibir el pago
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Dirección: RM1441, GUO LI Bldg, ZhongHang RD., Futian Dist. Shen Zhen, China
Proveedor Último login veces: Dentro de 1 Horas
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memoria IC IS42S16160G-7TLI de los 256M 143MHZ 54TSOP de la marca de ISSI.

 

 

CARACTERÍSTICAS

• Frecuencia de reloj: 200.166, 143 megaciclos

• Completamente síncrono; todas las señales referidas a un borde de reloj positivo

• Banco interno para el acceso/la precarga de ocultación de la fila

• Sola fuente de alimentación: 3.3V + 0.3V

• Interfaz de LVTTL

• Longitud programable de la explosión – (1, 2, 4, 8, página completa)

• Secuencia programable de la explosión: Secuencial/interpolación

• El auto restaura (CBR)

• El uno mismo restaura

• 8K restauran ciclos cada el ms 32 ms (grado A2) o 64 (comercial, industrial, el grado A1)

• Dirección de columna al azar cada ciclo de reloj

• Estado latente programable de CAS (2, 3 relojes)

• La explosión de lectura/grabación y la explosión leyeron/solo escriben capacidad de operaciones

• La terminación de la explosión por la parada de la explosión y la precarga ordenan

 

OPCIONES

• Paquete: 54 bola BGA del perno TSOP-II 54

• Gama de temperaturas de funcionamiento: Anuncio publicitario (0o C a +70o C) industrial (- 40o C al grado automotriz A1 de +85o C) (- 40o C al grado automotriz A2 de +85o C) (- 40o C a +105o C)

 

 

La COPITA síncrona de 256Mb de la DESCRIPCIÓN ISSI alcanza transferencia de datos de alta velocidad usando arquitectura de la tubería. Todas las entradas y señales de salidas refieren al borde de levantamiento de la entrada de reloj. El 256Mb SDRAM se organiza como sigue.

IS42S83200GIS42S16160G
8M x 8 x 4 bancosbancos x16x4 de los 4M
54-pin TSOPII54-pin TSOPII
54-ball BGA54-ball BGA

 

 

PARÁMETROS DOMINANTES DE LA SINCRONIZACIÓN

 

Parámetro-5-6-7Unidad
Duración de ciclo de Clk
Estado latente de CAS = 3567ns
Estado latente de CAS = 210107,5ns
Frecuencia de Clk
Estado latente de CAS = 3200166143Megaciclo
Estado latente de CAS = 2100100133Megaciclo
Tiempo de acceso del reloj
Estado latente de CAS = 355,45,4ns
Estado latente de CAS = 255,45,4ns

 

 

 

FamiliaMemoria
Serie-
EmpaquetadoBandeja
Formato - memoriaRAM
Tipo de la memoriaSDRAM
Tamaño de la memorialos 256M (el 16M x 16)
Velocidad143MHz
InterfazParalelo
Voltaje - fuente3 V ~ 3,6 V
Temperatura de funcionamiento-40°C ~ 85°C
Paquete/caso54-TSOP (0,400", anchura de 10.16m m)
Paquete del dispositivo del proveedor54-TSOP II

 

 

Dibujo:

 

 

 

 

 

 

 

 

 

 

 

 

 

 

 


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