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Lógica programable IC de la entrada-salida del dispositivo programable 160 de los circuitos integrados EPM570F256C5N max II
Especificaciones
Cualidad de producto | Valor del atributo |
---|---|
Categoría de producto: | CPLD - Dispositivo de lógica programable complejo |
EPM570 | |
SMD/SMT | |
FBGA-256 | |
2,5 V, 3,3 V | |
440 | |
Entrada-salida 160 | |
3,6 V | |
2,375 V | |
0 C | |
+ 70 C | |
304 megaciclos | |
5,4 ns | |
Bandeja | |
Tipo de la memoria: | De destello |
Número de bloques del arsenal de lógica - laboratorios: | 57 |
Número de elementos de lógica: | 570 |
Corriente de la fuente de funcionamiento: | 55 mA |
Descripción
Basan a la familia de MAX® II de inmediato-en, CPLDs permanente en los 0.18-µm, proceso de 6 capa-metal-flashes,
con los elementos de lógica de las densidades de 240 a 2.210 macrocells equivalentes (de LEs) (128 a 2.210) y permanente
almacenamiento de 8 Kbits. Los dispositivos del max II ofrecen altas cuentas de la entrada-salida, funcionamiento rápido, y la colocación confiable contra otra
Arquitecturas de CPLD. Atracción de la base de MultiVolt, de un bloque de memoria Flash del usuario (UFM), y del en-sistema aumentado
la programabilidad (ISP), dispositivos del max II se diseña para reducir coste y poder mientras que proporciona programable
soluciones para los usos tales como enlace del autobús, extensión de la entrada-salida, poder-en el reset (POR) y ordenando control,
y control de configuración de dispositivo.
Características
El max II CPLD tiene las características siguientes:
CPLD barato, de baja potencia
Inmediato-en, arquitectura permanente
Corriente espera de hasta sólo el µA 25
Proporciona tiempos rápidos del retraso y de la reloj-a-salida de propagación
Provee de cuatro relojes globales dos relojes disponibles por el bloque del arsenal de lógica (el LABORATORIO)
Bloque hasta 8 Kbits de UFM para el almacenamiento permanente
Base de MultiVolt permitiendo voltajes de fuente externa al dispositivo de cualquier 3,3 V de V/2.5 V o 1,8
Interfaz de la entrada-salida de MultiVolt que apoya niveles de la lógica 3.3-V, 2.5-V, 1.8-V, y 1.5-V
arquitectura Autobús-amistosa incluyendo la tarifa de ciénaga, la fuerza programables de la impulsión, autobús-control, y
programable levante los resistores
Schmitt acciona la permisión de las entradas tolerantes del ruido (programables por el perno)
I/Os son completamente obedientes con el grupo de interés especial componente periférico de la interconexión
(SIG del PCI) especificación del autobús urbano del PCI, revisión 2,2 para la operación 3.3-V en 66 megaciclos
Ayudas calientes-socketing
Conjunto de circuitos común incorporado de la prueba de la límite-exploración del grupo de acción de prueba (JTAG) (BST) obediente con
Estándar 1149.1-1990 de IEEE
Conjunto de circuitos de la ISP obediente con el estándar 1532 de IEEE
Guía comercial
Shiping | Período de entrega |
Para las piezas en existencia, las órdenes se estiman para enviar hacia fuera en 3 días. Una vez que está enviado, estimado plazo de expedición depende del abajo portadores que usted eligió: |
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Le notificaremos por el correo electrónico con número de seguimiento una vez que se envía la orden. |
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Vuelta garantía |
Vuelta |
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Garantía |
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El ordenar |
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