N&S CO. ELECTRÓNICO, LIMITÓ

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Alto BRAZO del tablero del desarrollo de la tarifa de datos de puerto TMS320C6748-DEV, tablero integrado del brazo del circuito de LSI de Digitaces DSP

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N&S CO. ELECTRÓNICO, LIMITÓ
Ciudad:shenzhen
Provincia / Estado:guangdong
País/Región:china
Persona de contacto:MsSavvy Ren
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Alto BRAZO del tablero del desarrollo de la tarifa de datos de puerto TMS320C6748-DEV, tablero integrado del brazo del circuito de LSI de Digitaces DSP

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Número de modelo :TMS320C6748-DEV
Cantidad de orden mínima :1pcs
Condiciones de pago :T/T, Western Union, D/P, D/A, L/C
Capacidad de la fuente :10000PCS
Plazo de expedición :1-2días
P/N :TMS320C6748-DEV
Tipo :Tableros del desarrollo
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Tableros del desarrollo de TMS320C6748-DEV, placa de circuito de la LSI de Digitaces DSP

 

 

Descripción de producto detallada

 

 

 

 

TMS320C40: Procesador de señal numérica flotante del rendimiento más alto (DSP)

– ‘320C40-60: 33 duraciones de ciclo de instrucción del ns, 330 FREGONAS, 60 MFLOPS, 30 MIPS, los 384M Bytes/s

– ‘320C40-50: duración de ciclo de instrucción de 40 ns

– ‘320C40-40: duración de ciclo de instrucción de 50 ns

Seis puertos de comunicaciones


Coprocesador del acceso directo de memoria del Seis-canal (acceso directo de memoria)

Solo - conversión del ciclo a y desde el formato flotante IEEE-754

Solo ciclo, 1/x, 1/SQRT (x)

Código fuente compatible con TMS320C3x

Solo - ciclo 40-Bit flotante, multiplicadores de 32 bits del número entero

Doce registros 40-Bit, ocho registros auxiliares, 14 registros de control, y dos contadores de tiempo

Exploración del límite de IEEE 1149,1 (JTAG) compatible

Dos autobuses idénticos de los datos externos y de dirección que apoyan los sistemas de memoria compartida y la alta Dato-tarifa, solos - transferencias del ciclo:

– Alto índice de los Puerto-datos del 120M Bytes /s (‘C40-60) (cada autobús)

– datos del programa continuo 16G-Byte/espacio de dirección periférico

– Pedido del Memoria-acceso el arbitraje rápido, inteligente del autobús

– Separe el Dirección-autobús, Dato-autobús, y Control-permita los pernos

– Cuatro sistemas de señales del Memoria-control apoyan diversas memorias de la velocidad en hardware

325 - Pin Ceramic Grid Array (sufijo de GF)

Fabricado usando 0,72 funcionamientos aumentados μm implantó tecnología (ÉPICA) del Cmos de Texas Instruments (el TI)

Reset del Software-Comunicación-puerto

Autobuses programa, datos, y del coprocesador internos separados del acceso directo de memoria para la ayuda de la entrada-salida concurrente masiva (entrada-salida) de la producción del programa y de datos, maximizando funcionamiento continuo de la unidad central de proceso (CPU)

En - Chip Program Cache y Dual-acceso/Solo-ciclo RAM para la memoria creciente - funcionamiento del acceso

– escondrijo de la instrucción 512-Byte

– bytes 8K de solo - programa o datos RAM del Dual-acceso del ciclo

– Programa de ayudas ROM-basado del cargador de bota Bootup usando 8, 16-, o de 32 bits

Memorias o uno de los puertos de comunicación

IDLE2 reloj - modo del poder-Abajo de la parada

operación 5-V

 

Nuestro Serices:

 

¿Por qué elíjanos N&S CO ELECTRÓNICO, .LTD?

 

Nueva y original calidad:

Todas las piezas son originales de fabricantes famosos internacionales.

 

Precio competitivo:

Toda la base de la cita en precio de mercado pronto, cantidad del pedido grande y respuesta rápida.

 

Entrega rápida y económica:

Todo el envío puede ser arreglar entrega en o antes de fecha de expedición confirmada, el cliente puede arreglar coger por su propio promotor,

también podemos flete aéreo foryouby del arrangedelivery, DHL, y algunas condiciones de expedición económicas por la carga pagada por adelantado.

 

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Carro de la investigación 0