CHUANGXINDA ELECTRONICS-TECH CO., LIMITED

CHUANGXINDA ELECTRONICS-TECH CO., LIMITÓ

Manufacturer from China
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6 Años
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Entrada-salida 1200 de XC5VLX330-1FF1760I 550MHz IC FPGA

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CHUANGXINDA ELECTRONICS-TECH CO., LIMITED
Ciudad:shenzhen
Provincia / Estado:guangdong
País/Región:china
Persona de contacto:CXDA-FPGA
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Entrada-salida 1200 de XC5VLX330-1FF1760I 550MHz IC FPGA

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Number modelo :XC5VLX330-1FF1760I
Cantidad de orden mínima :1 PCS
Condiciones de pago :T/T, Western Union, Paypal, garantía comercial, tarjeta de crédito
Capacidad de la fuente :86 PC
Plazo de expedición :3-5 día
Detalles de empaquetado :Empaquetado del estándar internacional
Categoría :Lógica programable ICs
Condición :Original 100%, a estrenar y original, nueva
Número de I/Os :Entrada-salida 1200
Producto :Virtex-5
Paquete/caso :FBGA-1760
RAM distribuido :kbit 3420
Bloque integrado RAM - EBR :kbit 10368
Frecuencia de funcionamiento máxima :550 megaciclos
Servicio :BOM Kitting
Plazo de ejecución :En existencia, contacto nosotros
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Entrada-salida 1200 de XC5VLX330-1FF1760I IC FPGA FBGA-1760 550 megaciclo Virtex-5

 

Cualidad de producto Valor del atributo
Xilinx
FPGA - Arsenal de puerta programable del campo
Virtex-5
Entrada-salida 1200
1 V
- 40 C
+ 100 C
SMD/SMT
FBGA-1760
Serie: XC5VLX330
Marca: Xilinx
RAM distribuido: kbit 3420
Bloque integrado RAM - EBR: kbit 10368
Frecuencia de funcionamiento máxima: 550 megaciclos
Humedad sensible:
Tipo de producto: FPGA - Arsenal de puerta programable del campo
Cantidad del paquete de la fábrica: 1
Subcategoría: Lógica programable ICs
Marca registrada: Virtex

 

 

Resumen de las características de Virtex-5 FPGA

 

• La mayoría del avanzado, de alto rendimiento, óptimo-utilización, tela de FPGA
Tecnología real de la tabla de operaciones de búsqueda de 6 entradas del − (LUT)
Opción dual 5-LUT del −
Encaminamiento mejorada − del reducir-salto
opción distribuida 64-bit de RAM del −
Opción del − SRL32/Dual SRL16

• Sincronización potente de la teja de la gestión del reloj (CMT)
Bloques del encargado de reloj de Digitaces del − (DCM) para proteger del retraso, la síntesis de la frecuencia, y el reloj cero defasador
Los bloques del − PLL para la entrada están inquietos filtrando, protegiendo cero del retraso, síntesis de la frecuencia, y división fase-hecho juego del reloj

• Capacidad de la supervisión de sistema en todos los dispositivos
En-microprocesador del −/supervisión termal fuera de chip
En-microprocesador del −/supervisión fuera de chip de la fuente de alimentación
Acceso del − JTAG a todas las cantidades supervisadas

• Bloques integrados de la punto final para los diseños de PCI Express
Plataformas del − LXT, de SXT, de TXT, y de FXT
− obediente con la especificación baja 1,1 de PCI Express
ayuda del carril x1, x4, o x8 del − por bloque
Trabajos del − conjuntamente con los transmisores-receptores de RocketIO™

Virtex®-5 FPGAs están disponibles en -3, -2, -1 grados de la velocidad, con -3 teniendo el rendimiento más alto. Virtex-5 FPGA DC
y las características de la CA se especifican para los grados comerciales e industriales. Excepto la temperatura de funcionamiento
la gama o a menos que se indicare en forma diferente, todos los parámetros eléctricos de DC y de la CA son lo mismo para una velocidad particular
grado (es decir, las características de la sincronización de un dispositivo industrial del grado de la velocidad -1 son lo mismo que para un grado de la velocidad -1
dispositivo comercial). Sin embargo, solamente los grados de la velocidad y/o los dispositivos seleccionados pudieron estar disponibles en la gama industrial.
Todas las especificaciones del voltaje de fuente y de la temperatura de empalme son representante de condiciones a lo peor.
los parámetros incluidos son comunes a los diseños populares y a los usos típicos.
 

 

 

Entrada-salida 1200 de XC5VLX330-1FF1760I 550MHz IC FPGA

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