Condiciones de pago :T/T, Western Union, Paypal, garantía comercial, tarjeta de crédito
Capacidad de la fuente :448 PC
Plazo de expedición :3-5 día
Detalles de empaquetado :Empaquetado del estándar internacional
Categoría :IC FPGA
Condición :Original 100%, a estrenar y original, nueva
Número de bloques del arsenal de lógica - laboratorios :3022
Número de I/Os :Entrada-salida 718
Paquete/caso :FBGA-1020
Voltaje de fuente de funcionamiento :1,2 V
Serie :Stratix II
Corriente de la fuente de funcionamiento :500 mA
Servicio :BOM Kitting
Plazo de ejecución :En existencia, contacto nosotros
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Entrada-salida Stratix II del microprocesador FBGA-1020 718 de EP2S60F1020I4N ALTERA FPGA
Cualidad de producto
Valor del atributo
Intel
FPGA - Arsenal de puerta programable del campo
Stratix II
60440
3022
Entrada-salida 718
1,2 V
- 40 C
+ 85 C
SMD/SMT
FBGA-1020
Bandeja
Serie:
Stratix II EP2S60
Marca:
Intel/Altera
Humedad sensible:
Sí
Corriente de la fuente de funcionamiento:
500 mA
Tipo de producto:
FPGA - Arsenal de puerta programable del campo
Cantidad del paquete de la fábrica:
24
Subcategoría:
Lógica programable ICs
Memoria total:
pedazo 2544192
Marca registrada:
Stratix II
Parte # alias:
973068
Los dispositivos de Stratix® II contienen una arquitectura bidimensional de la fila y columna-basado para ejecutar lógica de encargo. Una serie de columna y de fila interconecta de longitud diversa y la velocidad proporciona la señal interconecta entre los bloques del arsenal de lógica (laboratorios), estructuras de bloque de memoria (M512 RAM, Bloques de M4K RAM, y de M-RAM), y bloques del procesamiento de señales digitales (DSP).
Cada LABORATORIO consiste en ocho módulos de lógica adaptantes (limosnas). Un ALM es la unidad de creación básica de Stratix II de la familia del dispositivo de abastecimiento de la lógica puesta en práctica eficiente de las funciones de lógica del usuario. Los laboratorios se agrupan en filas y columnas a través del dispositivo.
Los bloques de M512 RAM son bloques de memoria simples del dual-puerto con 512 pedazos más la paridad (576 pedazos). Estos bloques proporcionan el dual-puerto simple dedicado o memoria del solo-puerto hasta 18 pedazos de par en par en hasta 500 megaciclos. Los bloques M512 se agrupan en columnas a través del dispositivo entre ciertos laboratorios.
■Ayuda diferenciada de alta velocidad de la entrada-salida con el conjunto de circuitos de los DPA para el funcionamiento 1-Gbps ■Ayuda para los estándares de alta velocidad del autobús del establecimiento de una red y de las comunicaciones incluyendo RapidIO paralelo, SPI-4 fase 2 (tecnología del nivel 4), de HyperTransport™ de POS-PHY, y SFI-4 ■Ayuda para la memoria externa de alta velocidad, incluyendo RDA y DDR2 SDRAM, RLDRAM II, QDR II SRAM, y SDR SDRAM ■Ayuda para la seguridad del diseño usando la encripción del bitstream de la configuración ■Ayuda para las actualizaciones de la configuración remota ■Hasta 16 relojes globales con 24 recursos de sincronización por la región del dispositivo ■Los bloques de gestión del reloj apoyan la red dinámica del reloj permiten/la neutralización, que permite que las redes del reloj accionen abajo para reducir el consumo de energía en modo del usuario
